因應聯電推出40eHV與40LP製程的0.213平方微米儲存單元,智原也推出相對應的SRAM編譯器。
智原指出,相較原先的0.242平方微米版本,新推出的編譯器在各種不同記憶體大小與架構配置條件下,可縮小記憶體面積達15%至30%。
智原表示,這將有助FHD與WQHD等高階面板驅動IC等講究SRAM矽智財(IP)面積的應用降低成本,提升競爭力。
因應聯電推出40eHV與40LP製程的0.213平方微米儲存單元,智原也推出相對應的SRAM編譯器。
智原指出,相較原先的0.242平方微米版本,新推出的編譯器在各種不同記憶體大小與架構配置條件下,可縮小記憶體面積達15%至30%。
智原表示,這將有助FHD與WQHD等高階面板驅動IC等講究SRAM矽智財(IP)面積的應用降低成本,提升競爭力。
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