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Xilinx針對OpenCL、C 和C++推出全新SDAccel開發環境將資料中心每瓦效能比提升高達25倍

美通社/ 2014.11.18 00:00
(Supercomputing 2014) 中針對 OpenCL?、C 和 C++ 推出 SDAccel?開發環境,可透過 FPGA

為資料中心應用加速提供高達25倍的每瓦效能比。SDAccel 是賽靈思 SDx? (軟體定義開發環境)

系列中的最新成員,結合業界首款架構最佳化的編譯器,可搭配 OpenCL、C 和 C++ 核心的任意組合使用,也提供函式庫和開發板,並首次為 FPGA

帶來完全類 CPU/GPU 的開發環境和運作時間體驗。

戴爾技術長辦公室平台架構與技術執行總監 Robert Hormuth 表示:「FPGA

技術的全新突破可實現各種最佳化的運算應用。在部署戴爾的伺服器時,我們需要更容易的編程方法來降低使用 FPGA 加速器的門檻。賽靈思為開發人員提供一個可讓

FPGA 平台使用者加速生產力的軟體環境,無疑是一個正確的發展方向。」

IBM 電源開發副總裁暨 OpenPOWER 總裁 Brad McCredie 表示:「IBM非常應同賽靈思為其 FPGA

元件實現軟體可編程能力的發展方向。利用 C、C++與 OpenCL 建置的最佳化 FPGA 加速器可帶來靈活性與QoR

(Quality-of-Results),有助於加速 IBM 為客戶帶來更大的價值。IBM 相信 OpenCL

有助提升生產力,目前正與賽靈思緊密合作將這項技術運用到各種 OpenPOWER 的產品設計。」

首款針對 OpenCL、C 和 C++的架構最佳化編譯器

相較於 CPU 和 GPU,SDAccel 的架構最佳化編譯器可提供高達25倍的每瓦效能比,其效能和資源使用率更是其他 FPGA

解決方案的3倍。SDAccel 運用超過1,000名程式設計人員使用的基礎編譯器技術,可充分發揮該編譯器的性能,並讓軟體開發人員採用全新或既有的

OpenCL、C 和 C++

程式碼建立高效能加速器,並針對運算搜尋、圖像識別、機器學習、轉碼、儲存壓縮和加密等各種資料中心應用的記憶體、資料流和迴圈管線等進行最佳化。

在 FPGA 上首次實現完全的類 CPU/GPU 開發經驗

透過 SDAccel 開發環境,開發人員可使用熟悉的工作流程為他們的應用進行最佳化,即使先前很少或者沒有 FPGA 使用經驗也能獲益於 FPGA

平台的優勢。整合設計環境 (IDE)

提供程式碼格式及軟體函式庫,並可針對所有開發目標進行編譯、除錯和特性設定,包括x86系統仿真、使用快速的模擬法進行效能驗證和 FPGA

處理器的原生執行作業等。整合設計環境在支援資料中心的 FPGA 平台上執行應用,而這些 FPGA

平台具備針對所有支援開發目標的自動儀表饋入功能。此外,SDAccel 的設計也能讓 CPU/GPU 開發人員使用更容易的方法將應用轉移到 FPGA

上,同時也在類似的工作流程中保留和重用他們的 OpenCL、C 和 C++程式碼。

完備的 SDAccel 開發環境包括程式設計人員隨時可用的整合設計環境、C 語言的 FPGA 最佳化函式庫,以及可支援資料中心的各種現成商用 (COTS)

平台。

SDAccel 函式庫包含 OpenCL 內建功能、數位訊號處理器

(DSP)、影音,以及為高效能低功耗作業而設的線性代數函式庫。而針對特定領域的加速,賽靈思聯盟計劃夥伴 Auviz Systems 則提供最佳化的

OpenCV 和可與 BLAS OpenCL 相容的函式庫。初期的 COTS 合作夥伴包括 Alpha Data、Convey 和 Pico

Computing 等公司,並預計2015年年初將有更多合作夥伴加入。

FPGA 上首次提供完全的類 CPU/GPU 運作時間體驗

唯有 SDAccel 可支援多個程式的大型應用及類 CPU/GPU 隨選載入運算單元。與 CPU/GPU 類似,SDAccel 對於 FPGA

解決方案的獨特之處在於它可在程式轉換時可讓系統續持運作。 SDAccel 是唯一在程式執行時可建立 FPGA 運算單元的開發環境,其中的 FPGA

運算單元可載入全新的加速器核心。在整個應用執行過程中,記憶體、乙太網路、PCIe?

和效能監控器等關鍵系統介面和功能,均可保持運行狀態。動態的可重配置運算單元也能夠讓多個應用共享 FPGA

加速器,例如可編程運算系統以支援影像搜尋、影音轉碼和影像處理之間的切換。

供貨時程

賽靈思於本週在美國紐爾良市登場的2014年國際超級運算大會中將進行 SDAccel 實機展示,展示攤位號碼為#3903。欲參加 SDAccel 早期採用計劃

並取得各種功能,請連絡賽靈思銷售代表。想瞭解更多相關資訊,請瀏覽http://www.xilinx.com/sdaccel

網站。SDAccel 以已發表的 Khronos

規格為基礎,並預期將通過Khronos符合性測試程序 (Khronos Conformance Testing Process),使用者可造訪

http://www.khronos.org/conformance

網站瞭解目前的符合性狀態。

關於SDx

SDx

是專為系統與軟體工程師所推出的軟體定義開發環境系列。SDx可讓非FPGA專業開發人員也能使用高階編程語言,以充分發揮可編程硬體和業界標準處理器的絕佳功能。欲瞭解更多資訊,請造訪

http://www.xilinx.com/sdx 。

關於賽靈思

賽靈思公司 (Xilinx, Inc.;NASDAQ:XLNX) 是全球 All Programmable FPGA、SoC與 3D ICs

的領導廠商。這些業界領先的元件與其新一代設計環境和IP相結合,將能滿足客戶對於可編程邏輯系統整合的多元需求。欲瞭解更多賽靈思公司資訊,請瀏覽

http://www.xilinx.com/ 網站。

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客戶證言?

戴爾技術長辦公室平台架構與技術執行總監 Robert Hormuth 表示:「FPGA

技術的全新突破可實現各種最佳化的運算應用。在部署戴爾的伺服器時,我們需要更容易的編程方法來降低使用 FPGA 加速器的門檻。賽靈思為開發人員提供一個可讓

FPGA 平台使用者加速生產力的軟體環境,無疑確立了正確的發展方向。」

IBM 電源開發副總裁暨 OpenPOWER 總裁 Brad McCredie 表示:「IBM應同賽靈思為其 FPGA

元件實現軟體可編程能力的發展方向。利用 C、C++與 OpenCL 建置的最佳化 FPGA 加速器可帶來靈活性與 QoR

(Quality-of-Results),有助於加速IBM為客戶帶來更大的價值。IBM 相信 OpenCL

有助提升生產力,目前正與賽靈思緊密合作將這項技術運用到各種 OpenPOWER 的產品設計。」

Keysight Technologies 的 Keysight Laboratories 副總裁暨總監 Steve Newton

表示:「作為賽靈思的長期客戶,我們對賽靈思藉由 SDAccel 帶來的突破性技術感到非常振奮,並期待可運用這項產品和 OpenCL

異質運算技術讓新一代的產品更加完美。」

Alpha Data 執行長 Adam Smith 表示:「Alpha Data 的高效能半長 Low Profile ADM-PCIE-7V3

Virtex-7 FPGA 板可支援賽靈思 SDAccel 開發環境,並運用 OpenCL、C 和 C++編程。SDAccel 結合我們的開發板後可協助

OpenCL應用開發人員獲得最佳的每瓦效能比,讓各種資料中心處理能力、系統塑型和市場分析應用達到更好的效果。」

Auviz Systems 創辦人暨執行長 Nagesh Gupta 表示:「Auviz Systems 為開發人員提供 C 語言 FPGA

最佳化的函式庫,並可與賽靈思 SDAccel 開發環境一起使用以達到加達效果。Auviz 採用 SDAccel 架構最佳化的編譯器,成功建立 OpenCV

函式庫來提升開發人員的生產力,並從 FPGA 元件中獲得比 CPU 和 GPU更高的效能。」

Convey Computer 執行長 Bruce Toal 表示:「Convey Wolverine 協同處理器與賽靈思為

OpenCL、C與C++推出的 SDAccel 開發環境等高階編程工具的結合,可加速高效能資料中心應用的效能。FPGA

加速器既為部分資料中心系統平台部署帶來全新水準的性價比,同時也能保持低功耗。」

Pico Computig 執行長 Jaime Cummins 表示:「Pico Computing 的模組化與高擴充性 FPGA

高效能運算系統可支援賽靈思的 SDAccel 開發環境,可讓成像、生物資訊學、網通、學術和其他高效能運算應用的 OpenCL

開發人員從所有賽靈思支援的元件系列中獲得最佳效能。」

消息來源 賽靈思公司

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